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HABER PAPER / REDACCIÓN

Inteligencia artificial — Página 4

Investigación, aplicaciones e infraestructura de datos de inteligencia artificial y anuncios empresariales verificados. Página 4.

122 noticias

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1 min de lectura

EmpresasPeríodo del evento / de los datos:

Un estudio analiza la representación de salida en generación RTL con LLM

Los autores comparan cómo influye la representación de salida en la generación de código RTL de hardware mediante modelos de lenguaje. La tarea acotada consiste en producir envoltorios de memoria SECDED con verificación formal.

Fuente: arXiv
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EmpresasPeríodo del evento / de los datos:

SpecKCast propone predicción espectral para acelerar inferencia de difusión

Un preprint presenta SpecKCast, un método de predicción de características destinado a reducir las evaluaciones repetidas de transformadores en modelos de difusión. Usa un enfoque de Kalman espectral para predecir características en pasos de eliminación de ruido omitidos.

Fuente: arXiv
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EmpresasPeríodo del evento / de los datos:

Un método mide el calor dentro de pilas de circuitos 3D

Investigadores presentan un método de caracterización térmica tridimensional de circuitos integrados avanzados. El flujo extrae propiedades térmicas por capa y construye una base de datos localizada para estudiar cómo circula el calor por la pila.

Fuente: arXiv
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EmpresasPeríodo del evento / de los datos:

Investigadores llevan el mapeo de escenas robóticas a una plataforma FPGA de borde

Un preprint presenta LENS, un sistema de localización de cámara y renderizado neuronal de escenas en una plataforma AMD KR260 FPGA y ARM. El trabajo adapta un flujo de coordenadas de escena y Gaussian Splatting a un dispositivo de borde que no requiere una GPU de escritorio.

Fuente: arXiv
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EmpresasPeríodo del evento / de los datos:

Simulación neuronal pequeña de C. elegans en Loihi-2

Un preprint describe un flujo para llevar una pequeña simulación neuronal de Caenorhabditis elegans al hardware neuromórfico Loihi-2 de Intel mediante NeuroML2Loihi. El estudio aborda el coste de actualizar repetidamente estados neuronales y sinápticos en software.

Fuente: arXiv
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PACT estudia el ajuste fino LoRA NVFP4 en GPU de consumo

Los investigadores presentan PACT, un sistema de ajuste fino LoRA en GPU de consumo que usa operaciones matriciales NVFP4 nativas para proyecciones congeladas. El artículo también trata la memoria de activaciones y el coste de cuantizar y des-cuantizar datos.

Fuente: arXiv
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EdgeKernelBench estudia la generación de kernels LLM para dispositivos de borde

EdgeKernelBench analiza si los grandes modelos de lenguaje pueden generar kernels para distintos equipos de borde. El preprint presenta una representación intermedia común y una evaluación jerárquica que conecta cargas con diferentes plataformas.

Fuente: arXiv
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Koi propone planificación autocorregible para inferencia LLM multicloud

Un preprint presenta Koi, un planificador de clúster para inferencia de grandes modelos de lenguaje en flotas multicloud heterogéneas. Trata la elección del acelerador, el paralelismo, el motor de servicio, el número de réplicas y las cargas cambiantes como decisiones interrelacionadas.

Fuente: arXiv
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Muse Glimmer 30B se presenta como modelo agéntico en dispositivo

Un preprint presenta Muse Glimmer, un modelo causal de lenguaje abierto de 30.000 millones de parámetros con codificador perceptivo para tareas agénticas en hardware de consumo. Los autores describen entradas de texto e imagen, razonamiento por pasos, uso de herramientas y recuperación de fallos.

Fuente: arXiv
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Un estudio analiza el entrenamiento LoRA en NPU de teléfonos

El preprint estudia si las unidades de procesamiento neuronal de los teléfonos pueden ayudar a ajustar modelos de lenguaje localmente con LoRA. Se centra en las operaciones repetidas con los pesos congelados que siguen siendo costosas aunque se entrenen pocos parámetros.

Fuente: arXiv
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EmpresasPeríodo del evento / de los datos:

SpikeDuet estudia redes neuronales dispersas en aceleradores de microcontrolador

Los autores analizan si el procesador matricial del microcontrolador EFR32MG24 puede acelerar la inferencia de redes neuronales de impulsos dispersas frente a una CPU Cortex-M33 optimizada. Su flujo convierte modelos snnTorch a C y reordena neuronas para aprovechar mejor el acelerador.

Fuente: arXiv
HABER PAPER

Cinco ediciones. Una mirada más amplia.

Una perspectiva multilingüe de la economía mundial.